申请/专利权人：索尼公司 - 专利清单
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| 申请日：2019-07-05 |
| 发明/设计人：关谷彰人;松本智宏;山岸弘幸;藤波靖;大池祐辅;池谷亮志 | 公开（公告）日：2025-03-11 |
| 代理机构：北京康信知识产权代理有限责任公司 | 公开（公告）号：CN112424786B |
| 代理人：吴孟秋 | 主分类号：G06G7/60 |
| 地址：日本东京 | 分类号：G06G7/60;G06N3/063;H03K5/26 |
| 专利状态码：有效-授权 | 优先权：["20180710 JP 2018-130692"] |
| 法律状态：2025.03.11#授权 2021.06.11#实质审查的生效 2021.02.26#公开 |
| 摘要：一种信号处理电路(12)，在第一输入信号改变的第一定时早于或与第二输入信号改变的第二定时相同的情况下，在第一定时输出第一输出信号并且在第二定时输出第二输出信号；并且在第一定时晚于第二定时的情况下，在第二定时输出第一输出信号和第二输出信号。 |
| 主权项：1.一种激活函数电路，包括：/n第一输入端，被配置为接收第一输入信号的输入；/n第二输入端，被配置为接收第二输入信号的输入；/n第一输出端，被配置为输出第一输出信号；/n第二输出端，被配置为输出第二输出信号；/n第一逻辑电路，包括：/n第一端，连接至所述第一输入端并被配置为从所述第一输入端接收所述第一输入信号；/n第二端，连接至所述第二输入端并被配置为从所述第二输入端接收所述第二输入信号；以及/n第三端，连接至所述第一输出端并被配置为将所述第一输出信号输出至所述第一输出端，/n其中，所述第一逻辑电路被配置为对从所述第一端接收的所述第一输入信号和从所述第二端接收的所述第二输入信号执行逻辑运算并且从所述第三端输出所述第一输出信号，其中，在第一输入信号改变的第一定时早于或与第二输入信号改变的第二定时相同的情况下，在所述第一定时输出所述第一输出信号并且在所述第二定时输出所述第二输出信号，并且在所述第一定时晚于所述第二定时的情况下，在所述第二定时输出所述第一输出信号和所述第二输出信号，/n所述激活函数电路，进一步包括：/n第二逻辑电路，对所述第二输入信号执行逻辑运算并且输出所述第二输出信号，/n其中，所述第二逻辑电路的电路延迟时间与所述第一逻辑电路的电路延迟时间相同。/n |
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